解密知識 解析 異步收發芯片

scc2691具有以下特性：

收發器的波特率可分別按以下方式定義：

可編程的數據格式為5~8位數據位；可選擇的奇偶校驗位；可編程的停止位。

從50~112k共18種固定的波特率；由計數器/定時器驅動的非標準自定義的波特率；外部時鐘的1倍或16倍頻。

可編程的通道方式。

2引腳定義

scc2691采用so、plcdip等形式封裝。主要引腳功能定義如下。

d0~d數據總線。在cpu和uart之間所有的數據、命令、狀態信息等都是通過數據總線進行傳遞的。在cen信號是有效低電平時，發送的方向由wrn和rdn兩個讀寫控制決定；當cen為高電平時，數據總線三態。

wrrdn和a0~a2等引腳控制；高電平時，使uart與cpu隔離。

wrn：寫選通，低電平有效。當cen為低電平時，wrn上的低電平使數據總線d0~d7上的數據被送往由地址a0~a2選中的寄存器中。

rdn：讀選通，低電平有效。當cen為低電平時，rdn上的低電平將被地址a0~a2選中的寄存器的內容送往數據總線d0~d7。

a0～a地址輸入端。選擇執行讀寫操作的uart寄存器。

reset：復位輸入端，高電平有效。復位時將清除uart中的狀態寄存器（sr）、中斷屏蔽寄存器（imr）、中斷狀態寄存器（isr），設置方式指針指向方式寄存器1（mr，使發送和接收失效，并且引腳txd置為高電平。intrn：中斷請求輸出端，低電平有效?？蓮钠邆€中斷源中選擇一個作為uart的中斷輸出。cpu可以讀中斷狀態寄存器（isr），以判斷七個中斷源的狀態。該引腳是漏極開路輸出，需要接上拉電阻。

x1/clk：晶體連接或外部時鐘輸入端。通常采用6864mhz的晶體。

x晶體連接端。若未連接晶體，最好使該引腳懸空。

rxd：串行數據輸入端。txd：串行數據輸出端。當發送器空閑、不使能或者uart工作在本地循環狀態下，該引腳輸出高電平。

mpo：多功能輸出端。

mpi：多功能輸入引腳。

3接收和發送

發送器接收來自cpu的并行數據，將其轉換為串行數據流送往txd端口，串行數據流被以一個開始位、可編程個數的數據位、可選擇的奇偶校驗位和可編程個數的停止位的組合形式發送出去。發送結束后，若沒有新的數據被送往發送保持寄存器（thr），則txd端腳保持高電平，并且狀態寄存器（sr）中的位txemt置1。當cpu將一個新的數據送往thr后，txemt位清零，發送操作繼續。發布一個開始break命令，可以使發送器發送一個break信號（持續的低電平）。發送器接收到一個終止發送的命令時，若其正在發送數據或thr中仍有數據，發送器會繼續發送直到thr為空截止。

接收器從rxd引腳接收串行數據，檢測其開始位、奇偶校驗位、終止位，若有錯誤則設置狀態寄存器（sr）中的相應位。接收器將數據送往接收保持寄存器（rhr），等待cpu以查詢方式或以中斷方式讀取數據，并且將sr中的rxrdy和中斷狀態寄存器（isr）的rxrdy位置1。

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